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EDA Playground ofrece a los ingenieros una exposición práctica inmediata para simular SystemVerilog, Verilog, VHDL, C++/ SystemC y otros HDL en un navegador web. El objetivo es acelerar el aprendizaje del desarrollo del diseño/banco de pruebas con un intercambio de código más fácil y un acceso más simple a las herramientas y bibliotecas EDA.
https://eda-playground.readthedocs.io/en/latest/tutorial.html
https://www.youtube.com/channel/UCP1LfE6VR_YfrcFiYhG_imA
VHDL es un lenguaje de especificación definido por el IEEE (Institute of Electrical and Electronics Engineers) (ANSI/IEEE 1076-1993) utilizado para describir circuitos digitales y para la automatización de diseño electrónico . VHDL es acrónimo proveniente de la combinación de dos acrónimos: VHSIC (Very High Speed Integrated Circuit) y HDL (Hardware Description Language).